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同步计数器是指计数器内各触发器配合利用同 一

发布时间:2019-09-13 关注次数:

  学生尝试演讲 尝试名称:用 74LS161 设想同步 12 进制计数器 学生姓名: 班级: 学号: 指点教员: 贾默伊 同组人: 成就: 一、尝试目标及要求: 1.尝试目标: (1)熟悉操纵 QuartusⅡ的道理图输入方式设想组合电。 (2)学会对尝试板上的 FPGA/CPLD 进行编程下载。 (3)硬件验证本人的设想项目。 2.尝试要求: (1)要求所设想的电有三个输入端: ? en:使能端,高电平无效; ? clear:端,清零端,低电平无效(清零) ; clk:脉冲输入端。 (2)五个输出端: ? q3--q0:计数形态端; ? cout:进位输出端,当计到十进制数 12 时,cout =1。 (3)要求对所设想的电仿线)下载到尝试板上。 二、尝试道理: 计数是一种最简单根基的运算,计数器就是实现这种运算的逻辑电, 计数器正在数字系统中次要是对脉冲的个数进行计数,以实现丈量、计数和 节制的功能,同时兼有分频功能,计数器是由根基的计数单位和一些节制 门所构成,计数单位则由一系列具有存储消息功能的各类触发器形成,这 些触发器有 RS 触发器、T 触发器、D 触发器及 JK 触发器等。 按照计数器中的触发器能否同时翻脉冲信号分类,可将计数器分为同步 计数器和异步计数器两种。同步计数器是指计数器内各触发器配合利用同 一个输入的时钟,正在统一个时辰翻转,计数速度快。异步计数器是指计数 器内各触发器的输入时钟信号的来历分歧,各电的翻转时辰也纷歧样, 因而计数速度慢。 74LS161 是 4 位二进制同步加法计数器, 除了有二进制加法计数功能外, 还具有异步清零、同步置数、连结等功能。 三、尝试步调: ⒈道理图输入 正在 QuartusⅡ软件界面下,正在 .bdf 文件中输入道理图如下: 第 批阅教员 : 页 共 页 年 月 日 学生尝试演讲 顺次进行编译、分析、适配等步调。 ⒊成立波形文件并对其进行仿实,此中功能仿实图形如下: 当时序仿实图形如下: 第 批阅教员 : 页 共 页 年 月 日 学生尝试演讲 四、尝试申明: 74161 是一个同步置数、异步清零的 16 进制计数器,正在输出为 11 时触 发 LD 端,鄙人一个脉冲即可回到 0 的形态,同时,正在正在输出为 11 时,输 出 cout =1,能够实现操纵 LD 端实现同步 12 进制计数器。 第 批阅教员 : 页 共 页 年 月 日

  74ls161做12进制计数器_计较机软件及使用_IT/计较机_专业材料。学生尝试演讲 尝试名称:用 74LS161 设想同步 12 进制计数器 学生姓名: 班级: 学号: 指点教员: 贾默伊 同组人: 成就: 一、尝试目标及要求: 1.尝试目标: (1)熟悉操纵 Qua